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xilinx ddr3
Xilinx Spartan 6的DDR3原理圖+用戶手冊(cè)

feilg

2016/08/08

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資訊

Xilinx PCIe高速接口入門實(shí)戰(zhàn)（二）

本文詳細(xì)介紹7 Series Intergrated Block for PCI ExpressPCIe硬核IP接口功能描述及PCIe配置空間相關(guān)內(nèi)容。

FPGA技術(shù)實(shí)戰(zhàn)

541

12/06 14:58

PCIE xilinx
Xilinx PCIe高速接口入門實(shí)戰(zhàn)（一）

本文對(duì)Xilinx 7 Series Intergrated Block for PCI Express PCIe硬核IP進(jìn)行簡(jiǎn)要介紹，主要包括7系列FPGA PCIe硬核資源支持、三IP硬核差異、PCIe硬核資源利用等相關(guān)內(nèi)容。

FPGA技術(shù)實(shí)戰(zhàn)

1494

11/29 08:35

PCIE xilinx
后摩爾時(shí)代的創(chuàng)新：在米爾FPGA上實(shí)現(xiàn)Tiny YOLO V4，助力AIoT應(yīng)用

在全球半導(dǎo)體制程限制和高端 GPU 受限的大環(huán)境下，F(xiàn)PGA 成為了中國(guó)企業(yè)發(fā)展的重要路徑之一。它可支持靈活的 AIoT 應(yīng)用，其靈活性與可編程性使其可以在國(guó)內(nèi)成熟的 28nm 工藝甚至更低節(jié)點(diǎn)的制程下實(shí)現(xiàn)高效的硬件加速。

米爾電子

812

11/21 12:08

FPGA AIoT
Xilinx FPGA DDR3設(shè)計(jì)（三）DDR3 IP核詳解及讀寫測(cè)試

本文我們介紹下Xilinx DDR3 IP核的重要架構(gòu)、IP核信號(hào)管腳定義、讀寫操作時(shí)序、IP核詳細(xì)配置以及簡(jiǎn)單的讀寫測(cè)試。

FPGA技術(shù)實(shí)戰(zhàn)

5.8萬(wàn)

09/23 14:28

FPGA xilinx
FIFO復(fù)位流程

在FIFO的使用過(guò)程中不可避免的在某些應(yīng)用下必須使用reset信號(hào)，將當(dāng)前FIFO中數(shù)據(jù)清空，但是我們現(xiàn)在調(diào)用的xilinx的FIFO核在復(fù)位條件不滿足時(shí)會(huì)偶現(xiàn)FIFO進(jìn)入復(fù)位狀態(tài)無(wú)法恢復(fù)，必須重新斷上電才能恢復(fù)的問(wèn)題，所以在使用FIFO時(shí)我們必須嚴(yán)格的按照datasheet上要求執(zhí)行，以免出現(xiàn)異常。

森森Tech

2051

09/03 18:55

xilinx vivado

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