FPGA常見(jiàn)IP（FIFO，ddr3，qdrII +，aurora）的使用及設(shè)計(jì)技巧

課程簡(jiǎn)介：

本課程針對(duì)FPGA中常用IP核，如FIFO，ddr3 controller，qdrII+ controller，aurora，RapidIO Gen2等在使用設(shè)計(jì)過(guò)程中遇到的問(wèn)題和技巧進(jìn)行歸納總結(jié)。內(nèi)容包括：Verilog Coding過(guò)程常見(jiàn)的錯(cuò)誤；ISE中將代碼封裝成IP核的方法；Standard FIFO和FWFT FIFO的應(yīng)用比較；設(shè)計(jì)DDR3 SDRAM 控制器和QDRII+ SRAM控制器的注意事項(xiàng)；Aurora協(xié)議的關(guān)鍵技術(shù)；RapidIO Gen2 IP核開(kāi)發(fā)例程。

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