課程簡介:
Verilog RTL 編程實踐最大的特點是工程實踐和代碼分析,適合數字集成電路設計人員學習,已達到快速掌握Verilog芯片設計語言,熟悉邏輯仿真和邏輯綜合技術的目的。該課程主要講授數字集成電路設計中常用的理論和技能,以及芯片設計中常遇到的仿真和綜合方法。該課程包含多個典型的數字電路設計實例:計數器,存儲器,狀態(tài)機,FIFO,串并轉換器等,尤其是數字電路設計中PLL設計應用,時序仿真中的延遲反標,可測試性設計以及功能仿真等實用技術。
該課程重點在于提高數字芯片設計的工程實踐能力,全面掌握Verilog設計數字電路的設計方法。學習完該課程可以勝任數字集成電路設計工程師的職位。