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隨著人工智能、大數(shù)據(jù)、云計(jì)算等技術(shù)的發(fā)展，算力需求爆發(fā)式增長(zhǎng)。AI訓(xùn)練、推理所面對(duì)的數(shù)據(jù)量指數(shù)增長(zhǎng)，使得無(wú)論單服務(wù)器中多GPU、CPU間C2C通信，還是在多服務(wù)器間組網(wǎng)，數(shù)據(jù)傳輸總體都呈現(xiàn)出高帶寬、低延遲的技術(shù)需求。2024年5月28日，是德科技誠(chéng)邀您蒞臨Keysight World 2024“人工智能與數(shù)據(jù)中心互連新技術(shù)分論壇”，圍繞芯片間互連設(shè)計(jì)、高速電互連及AI/ML光互連等新技術(shù)進(jìn)行全方位的技術(shù)交流和探討。

會(huì)議日程

人工智能技術(shù)與高速互連新技術(shù)分論壇
13:30-14:10	智能連接賦能生成式人工智能時(shí)代	AsterLabs，劉亮
14:10-14:50	AI時(shí)代互連技術(shù)革新：PCIe6.0/7.0發(fā)展趨勢(shì)與測(cè)試挑戰(zhàn)	PCI-SIG 協(xié)會(huì)，Rick Eads 是德科技，馬卓凡
14:50-15:00	休息
15:00-15:30	AI時(shí)代UCIe通用小芯片互連接口技術(shù)仿真	是德科技，李串寶
15:30-16:10	AI時(shí)代高速Ethernet/InfiniBand互連技術(shù)(112G/224G)方案	是德科技，張曉
16:10-16:40	AI時(shí)代內(nèi)存革新：探索HBM與DDR技術(shù)演進(jìn)及測(cè)量解決	是德科技，顏振龍
16:40-16:50	答疑與抽獎(jiǎng)

嘉賓介紹

劉亮 — AsteraLabs亞洲技術(shù)支持經(jīng)理

16年高速接口芯片產(chǎn)品經(jīng)驗(yàn)，包括系統(tǒng)設(shè)計(jì)、應(yīng)用支持和芯片產(chǎn)品定義。2010年到2019年服務(wù)于Texas Instruments，隨后加入AsteraLabs，現(xiàn)任AsteraLabs亞洲技術(shù)支持團(tuán)隊(duì)經(jīng)理。

Rick Eads — PCI-SIG組織董事會(huì)主席成員

Rick是是德科技PCI Express項(xiàng)目經(jīng)理和高級(jí)產(chǎn)品經(jīng)理，同時(shí)任職于PCI- SIG董事會(huì)，負(fù)責(zé)PCI Express、PCI和PCI- x串行總線標(biāo)準(zhǔn)。他致力于精密產(chǎn)品定義和突破性解決方案的綜合，以滿足軟件和硬件產(chǎn)品的新需求。他在行業(yè)組織內(nèi)提供PCI Express、FB-DIMM (FBD)、DDR、HyperTransport、ExpressCard、SATA和InfiniBand驅(qū)動(dòng)標(biāo)準(zhǔn)的技術(shù)領(lǐng)導(dǎo)。他曾從事示波器，邏輯分析儀，微處理器仿真解決方案，ASIC仿真工具，EDA工具的市場(chǎng)測(cè)試和測(cè)量產(chǎn)品。

馬卓凡 —?是德科技資深數(shù)字應(yīng)用工程師

是德科技技術(shù)專家，于2006年加入安捷倫科技，主要從事高速數(shù)字技術(shù)測(cè)試測(cè)量方案的開(kāi)發(fā)和應(yīng)用，負(fù)責(zé)示波器、誤碼儀、邏輯及協(xié)議分析儀等產(chǎn)品的技術(shù)咨詢和支持工作。

李串寶 — 是德科技EDA軟件解決方案工程師

上海交通大學(xué)電子與通信工程碩士學(xué)位，目前擔(dān)任是德科技 PathWave設(shè)計(jì)軟體部門解決方案工程師，主要負(fù)責(zé)信號(hào)完整性領(lǐng)域的應(yīng)用支持工作。

張曉 — 是德科技資深數(shù)字解決方案工程師

是德科技技術(shù)專家，于2016年加入是德科技，專注于高速數(shù)字測(cè)試及相關(guān)應(yīng)用，擁有10年以上的研發(fā)和測(cè)試經(jīng)驗(yàn)；目前主要負(fù)責(zé)華東地區(qū)示波器、誤碼儀、邏輯協(xié)議分析儀等產(chǎn)品及應(yīng)用的技術(shù)咨詢和支持工作。

顏振龍 — 是德科技資深數(shù)字解決方案工程師

2019年4月份加入是德科技，15年工作經(jīng)驗(yàn)，之前在多家公司從事高速信號(hào)測(cè)試工作，主要涉及高速數(shù)字接口，信號(hào)完整性等高速數(shù)字系統(tǒng)的測(cè)試，應(yīng)用與研究。

演講摘要

智能連接賦能生成式人工智能時(shí)代
生成式人工智能對(duì)數(shù)據(jù)、計(jì)算和存儲(chǔ)資源的巨大需求，以及由此帶來(lái)了對(duì)高性能和高可靠性連接性的需求。本專題我們將會(huì)討論P(yáng)CIe? 6.x在人工智能服務(wù)器平臺(tái)中的挑戰(zhàn)以及如何克服這些挑戰(zhàn)，并確保PCIe? 6.x技術(shù)在這些平臺(tái)中的成功應(yīng)用。與此同時(shí)，我們也會(huì)介紹COSMOS，一個(gè)用于云和人工智能基礎(chǔ)設(shè)施的診斷和遙測(cè)解決方案。

AI時(shí)代互連技術(shù)革新：PCIe6.0/7.0發(fā)展趨勢(shì)與測(cè)試挑戰(zhàn)
PCIe在新興的人工智能時(shí)代中扮演了至關(guān)重要的角色。自2003年（PCI Express）問(wèn)世以來(lái)，PCIe一直被用作CPU與計(jì)算機(jī)子系統(tǒng)之間的通信協(xié)議。由AI和ML推動(dòng)的計(jì)算互連帶寬需求正在加速向下一代PCIe（PCIe Gen 6/ PCIe Gen 7）的轉(zhuǎn)變。本專題是德科技專家將會(huì)攜手PCI-SIG 組織成員Rick Eads帶來(lái)下一代PCI Express技術(shù)發(fā)展趨勢(shì)與測(cè)試挑戰(zhàn)。

AI時(shí)代UCIe通用小芯片互連接口技術(shù)仿真
在人工智能(AI)和虛擬現(xiàn)實(shí)(VR)技術(shù)飛速發(fā)展的今天，對(duì)芯片的要求越來(lái)越高，芯片要具備低功耗、低時(shí)延、高算力等特性。另一方面，晶體管變得越來(lái)越難小，工藝愈加接近物理極限，在這種情況下，小芯片就應(yīng)用而生了。小芯片是一種功能模塊化的裸片（Die）封裝，這些Die之間使用UCIe(一種開(kāi)放的行業(yè)標(biāo)準(zhǔn))來(lái)相互通信。在本專題中，您將了解晶片高速標(biāo)準(zhǔn)互聯(lián)的基本原理，包括從一個(gè)D2D PHY到另一個(gè)D2D PHY的接口通信。此外，您將探索如何使用智能設(shè)計(jì)平臺(tái)輕松計(jì)算和簡(jiǎn)化眼圖、誤碼率(BER)、和電壓傳遞函數(shù)(VTF)等的分析計(jì)算。

AI時(shí)代高速Ethernet/InfiniBand互連技術(shù)(112G/224G)方案
生成式AI和大模型的不斷發(fā)展，對(duì)交換芯片、網(wǎng)絡(luò)芯片和高速互連網(wǎng)絡(luò)提出了越來(lái)越高的要求：對(duì)于遠(yuǎn)距離傳輸?shù)墓馔ㄓ嵕W(wǎng)絡(luò)，目前已經(jīng)演進(jìn)到單波112Gbps，并且快速向單波224Gbps邁進(jìn)；對(duì)于近距離傳輸，支持單條Lane 112Gbps電信號(hào)傳輸，已經(jīng)逐漸變成行業(yè)的共識(shí)。本專題將會(huì)對(duì)涉及的高速Ethernet(IEEE 802.3ck/df/dj)和Infinband(NDR/XDR)光電標(biāo)準(zhǔn)進(jìn)行解讀，全面介紹是德科技完整的物理層測(cè)試解決方案。

AI時(shí)代內(nèi)存革新：探索HBM與DDR技術(shù)演進(jìn)及測(cè)量解決方案
隨著人工智能（AI）技術(shù)的飛速發(fā)展，對(duì)內(nèi)存的需求呈現(xiàn)出前所未有的增長(zhǎng)，內(nèi)存技術(shù)的革新成為推動(dòng)AI應(yīng)用性能提升的關(guān)鍵。本次演講將深入探討人工智能領(lǐng)域高帶寬內(nèi)存（HBM）與雙數(shù)據(jù)速率（DDR）內(nèi)存技術(shù)的創(chuàng)新和應(yīng)用，剖析新內(nèi)存技術(shù)的測(cè)量解決方案與挑戰(zhàn)。

直播福利

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