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英特爾展示晶背供電實(shí)作成果 20A制程開始導(dǎo)入

2023/06/12
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在現(xiàn)有的晶片互聯(lián)架構(gòu)下,電源跟訊號(hào)線路都集中在晶片正面,導(dǎo)致晶片正面變得異常擁擠,也不利于縮小晶片尺寸。為此,半導(dǎo)體業(yè)界一直在探索將電源分配網(wǎng)路(Power Distribution Network, PDN)轉(zhuǎn)移到晶片背面可行性,以解決線路擁塞的問題。英特爾(Intel)近日宣布,該公司在晶背供電(Backside Power Delivery)領(lǐng)域取得重要突破,并成為業(yè)界第一家在類產(chǎn)品(Product-like)的測(cè)試晶片上實(shí)作晶背供電的公司。英特爾預(yù)計(jì)將在2024年量產(chǎn)的20A製程節(jié)點(diǎn)為晶圓代工服務(wù)的客戶提供此一技術(shù)選項(xiàng)。

英特爾開發(fā)代號(hào)為Blue Sky Creek的測(cè)試晶片為業(yè)界首次在類似真實(shí)晶片上實(shí)作晶背供電的成功案例,此一突破解決數(shù)十年來的互連瓶頸,預(yù)計(jì)將于2024年成為Intel 20A製程節(jié)點(diǎn)的其中一部份

英特爾技術(shù)開發(fā)副總裁Ben Sell指出,PowerVia是英特爾「4年5個(gè)節(jié)點(diǎn)」策略以及邁向2030年達(dá)成單一封裝內(nèi)含1兆個(gè)電晶體過程中的重要里程碑。使用試驗(yàn)性的製程節(jié)點(diǎn)及隨后的測(cè)試晶片,讓英特爾降低晶背供電對(duì)于領(lǐng)先製程節(jié)點(diǎn)的風(fēng)險(xiǎn),并讓英特爾在晶背供電導(dǎo)入市場(chǎng)方面,領(lǐng)先競(jìng)爭(zhēng)對(duì)手一個(gè)節(jié)點(diǎn)世代。

英特爾將PowerVia從電晶體的開發(fā)中分離出來,以確保實(shí)作于Intel 20A和Intel 18A製程節(jié)點(diǎn)晶片時(shí),該技術(shù)已準(zhǔn)備就緒。與Intel 20A的RibbonFET整合之前,PowerVia已在其內(nèi)部測(cè)試節(jié)點(diǎn)進(jìn)行測(cè)試和除錯(cuò),確認(rèn)該技術(shù)具備良好的功能性。製造該測(cè)試晶片并測(cè)試之后,PowerVia已被證實(shí)能夠顯著且有效地利用晶片資源,單元利用率超過90%,讓晶片設(shè)計(jì)人員能夠在產(chǎn)品中提升效能和效率。英特爾將于6月11日至16日在日本京都舉行的VLSI研討會(huì)上,發(fā)表兩篇論文來介紹這些技術(shù)。

PowerVia為晶片設(shè)計(jì)人員首次解決日益嚴(yán)重的互連瓶頸問題。隨著人工智慧和電腦圖形在內(nèi)等領(lǐng)域的應(yīng)用不斷增加,需要更小、更密集和更強(qiáng)大的電晶體來滿足不斷成長(zhǎng)中的運(yùn)算要求。過去數(shù)十年來直至今日,連接電晶體的電源線和訊號(hào)線架構(gòu)總是在爭(zhēng)奪相同的資源。藉由分離這兩者,能夠提升晶片的效能和能源效率,為客戶提供更好的結(jié)果。晶背供電對(duì)于電晶體微縮十分重要,讓晶片設(shè)計(jì)人員能夠在毋須犧牲資源的情況下提升電晶體密度,提供相較過往更高的功率和效率。

Intel 20A和Intel 18A均會(huì)導(dǎo)入PowerVia晶背供電技術(shù)和RibbonFET環(huán)繞式閘極技術(shù)。作為一款全新的電晶體電源傳輸方式,晶背供電實(shí)作也向散熱和除錯(cuò)設(shè)計(jì)提出新的挑戰(zhàn)。英特爾工程師開發(fā)出避免散熱問題的緩和技術(shù),除錯(cuò)小組也發(fā)展出新技術(shù),確保新款設(shè)計(jì)結(jié)構(gòu)能夠被正確除錯(cuò)。實(shí)作測(cè)試的結(jié)果顯示出穩(wěn)定的良率和可靠性指標(biāo),于整合RibbonFET架構(gòu)之前就展現(xiàn)出該技術(shù)優(yōu)秀的內(nèi)在價(jià)值。

該測(cè)試還利用極紫外光(EUV)微影的設(shè)計(jì)規(guī)則,其結(jié)果包含在晶片大面積上達(dá)成超過90%的標(biāo)準(zhǔn)單元利用率,提升單元密度同時(shí)降低成本。本測(cè)試還顯示出平臺(tái)電壓下降幅度改善超過30%以及6%的頻率優(yōu)勢(shì)。英特爾也迎合邏輯單元微縮隨之而來的高功率密度,在PowerVia測(cè)試晶片達(dá)成所需散熱特性。

于VLSI舉行期間公開的第三篇論文,英特爾技術(shù)專家Mauro Kobrinsky將解釋英特爾對(duì)于部署更先進(jìn)PowerVia方法的研究,例如在晶圓的正面或背面同時(shí)實(shí)現(xiàn)訊號(hào)和電源傳輸。

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